AD9371 官方例程构建及单音信号收发

AD9371 系列快速入口

AD9371+ZCU102 移植到 ZCU106 ： AD9371 官方例程构建及单音信号收发

ad9371_tx_jesd -->util_ad9371_xcvr接口映射： AD9371 官方例程之 tx_jesd 与 xcvr接口映射

AD9371 官方例程 时钟间的关系与生成 ： AD9371 官方例程HDL详解之JESD204B TX侧时钟生成（一）

JESD204B相关IP端口信号 ： AD9371 官方例程HDL JESD204B相关IP端口信号

裸机程序配置 AD9528、AD9371、FPGA IP 和主函数梳理： AD9371 官方例程裸机SW 和 HDL配置概述（一）

裸机程序配置 AD9528、AD9371、FPGA IP 和主函数梳理： AD9371 官方例程裸机SW 和 HDL配置概述（二）

前言

项目构建基本流程和AD9361差不多，由于官方使用的ZCU102，记录下移植遇到的一些问题

一、HDL方面

1. ZYNQ 核根据ZCU106平台修改（参考UG1244 ZCU106 Evaluation Board），尤其注意DDR的配置（参考美光 MTA4ATF51264HZ）

2.dacfifo 深度 要修改 ，地址位宽 小于等于16，zcu102中 fifo 128位数据 深度2^17 需要16.7Mb ，ZU9EG BRAM 32Mb可以满足 , zcu106 BRAM 11Mb，16.7Mb 超出了106能力 ，深度改成16就可以了

3. XDC引脚要修改正确

示例如下：

set_property  -dict {
   
   PACKAGE_PIN  U2   } [get_ports rx_data_p[0]]                                      ; ## A02  FMC_HPC0_DP1_M2C_P
set_property  -dict {
   
   PACKAGE_PIN  U1   } [get_ports rx_data_n[0]]                                      ; ## A03  FMC_HPC0_DP1_M2C_N
set_property  -dict {
   
   PACKAGE_PIN  P4   } [get_ports rx_data_p[1]]                                      ; ## A06  FMC_HPC0_DP2_M2C_P
set_property  -dict {
   
   PACKAGE_PIN  P3   } [get_ports rx_data_n[1]]                                      ; ## A07  FMC_HPC0_DP2_M2C_N

4. RX接收不到正弦，测试发现TX有问题，HDL侧修改方案

axi_ad9371_dacfifo 中 dac_rst_int_s 应该在dac_xfer_req 上升沿有效，代码也产生了上升沿，但是 assign dac_rst_int_s = dac_xfer_req | dac_rst;用错了信号

  assign dac_xfer_posedge_s = ~dac_xfer_req_d & dac_xfer_req