dfs-数的拆分

【vivado PG学习】1 PG168:7 Series FPGAs Transceivers官方配置方法学习笔记 介绍: The 7 series FPGAs Transceivers Wizard LogiCORE™ IP 自动创建配置7系列fpga 收发器的HDL封装。向导可以配置一个或多个支持行业主流标准的高速串行收发器。或者从零开始支持各种自定义协议。 功能: 创建配置7系列fpga 收发器的HDL封装。 自动对模拟设置进行配置。 预定义了提供Aurora 8B/10B, Aurora 64B/66B, CEI-6G,DisplayPort, Interlaken, Open Base StationAr.. 阅读详情

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#include<iostream>
using namespace std;

int n,a[100]={1},m;

void out(int f){
	for (int i=1;i<=f;i++){//改动 
		cout<<a[i]<<"+";
	}
	cout<<m<<endl;//改动 
}

void yyy(int g){
	int i=a[g-1];
	while (i<=m&&i!=n){
		a[g]=i;
		m=m-i;
		cout<<g<<"  "<<i<<"  ";//
		out(g); //
		if (m>=i) 	//改动 
		{			//改动 
			out(g); 
			yyy(g+1); 
			cout<<g<<"  "<<i<<"  ";//
			out(g); //
			
		} 
		m=m+i;
		i++;
		cout<<g<<"  "<<i<<"  ";//
		out(g); //
	}
}

int main(){
	cin>>n;
	m=n;
	yyy(1);
}

在这里插入图片描述

#include<iostream>
using namespace std;

int n,a[100]={1},m;

void out(int f){
	for (int i=1;i<=f;i++){//改动 
		cout<<a[i]<<"+";
	}
	cout<<m<<endl;//改动 
}

void yyy(int g){
	int i=a[g-1];
	while (i<=m&&i!=n){
		a[g]=i;
		m=m-i;
		if (m>=i) 	//改动 
		{			//改动 
			//out(g); 
			yyy(g+1); 
			out(g);//
		} 
		m=m+i;
		i++;
	}
}

int main(){
	cin>>n;
	m=n;
	yyy(1);
}
RK3568 HDMI输出调试:分辨率切换与EDID解析 厂商信息(Vendor ID)显示器型号(Product ID)支持的分辨率列表色彩特性音频支持情况检查项方法HPD 信号EDID 读取当前模式TMDS 时钟PHY 状态。 阅读详情

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